Motor.elf: file format elf32-avr
Sections:
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Disassembly of section .text:
00000000 <__vectors>:
0: 19 c0 rjmp .+50 ; 0x34 <__ctors_end>
2: 33 c0 rjmp .+102 ; 0x6a <__bad_interrupt>
4: 32 c0 rjmp .+100 ; 0x6a <__bad_interrupt>
6: 31 c0 rjmp .+98 ; 0x6a <__bad_interrupt>
8: 30 c0 rjmp .+96 ; 0x6a <__bad_interrupt>
a: 2f c0 rjmp .+94 ; 0x6a <__bad_interrupt>
c: 2e c0 rjmp .+92 ; 0x6a <__bad_interrupt>
e: 2d c0 rjmp .+90 ; 0x6a <__bad_interrupt>
10: 2c c0 rjmp .+88 ; 0x6a <__bad_interrupt>
12: 2b c0 rjmp .+86 ; 0x6a <__bad_interrupt>
14: 2a c0 rjmp .+84 ; 0x6a <__bad_interrupt>
16: 29 c0 rjmp .+82 ; 0x6a <__bad_interrupt>
18: 28 c0 rjmp .+80 ; 0x6a <__bad_interrupt>
1a: 27 c0 rjmp .+78 ; 0x6a <__bad_interrupt>
1c: 26 c0 rjmp .+76 ; 0x6a <__bad_interrupt>
1e: 25 c0 rjmp .+74 ; 0x6a <__bad_interrupt>
20: 24 c0 rjmp .+72 ; 0x6a <__bad_interrupt>
22: 23 c0 rjmp .+70 ; 0x6a <__bad_interrupt>
24: 22 c0 rjmp .+68 ; 0x6a <__bad_interrupt>
26: 21 c0 rjmp .+66 ; 0x6a <__bad_interrupt>
28: 20 c0 rjmp .+64 ; 0x6a <__bad_interrupt>
2a: 1f c0 rjmp .+62 ; 0x6a <__bad_interrupt>
2c: 1e c0 rjmp .+60 ; 0x6a <__bad_interrupt>
2e: 1d c0 rjmp .+58 ; 0x6a <__bad_interrupt>
30: 1c c0 rjmp .+56 ; 0x6a <__bad_interrupt>
32: 1b c0 rjmp .+54 ; 0x6a <__bad_interrupt>
00000034 <__ctors_end>:
34: 11 24 eor r1, r1
36: 1f be out 0x3f, r1 ; 63
38: cf ef ldi r28, 0xFF ; 255
3a: d2 e0 ldi r29, 0x02 ; 2
3c: de bf out 0x3e, r29 ; 62
3e: cd bf out 0x3d, r28 ; 61
00000040 <__do_copy_data>:
40: 11 e0 ldi r17, 0x01 ; 1
42: a0 e0 ldi r26, 0x00 ; 0
44: b1 e0 ldi r27, 0x01 ; 1
46: ea e3 ldi r30, 0x3A ; 58
48: f1 e0 ldi r31, 0x01 ; 1
4a: 02 c0 rjmp .+4 ; 0x50 <__do_copy_data+0x10>
4c: 05 90 lpm r0, Z+
4e: 0d 92 st X+, r0
50: a0 31 cpi r26, 0x10 ; 16
52: b1 07 cpc r27, r17
54: d9 f7 brne .-10 ; 0x4c <__do_copy_data+0xc>
00000056 <__do_clear_bss>:
56: 11 e0 ldi r17, 0x01 ; 1
58: a0 e1 ldi r26, 0x10 ; 16
5a: b1 e0 ldi r27, 0x01 ; 1
5c: 01 c0 rjmp .+2 ; 0x60 <.do_clear_bss_start>
0000005e <.do_clear_bss_loop>:
5e: 1d 92 st X+, r1
00000060 <.do_clear_bss_start>:
60: a1 31 cpi r26, 0x11 ; 17
62: b1 07 cpc r27, r17
64: e1 f7 brne .-8 ; 0x5e <.do_clear_bss_loop>
66: 3f d0 rcall .+126 ; 0xe6 <main>
68: 66 c0 rjmp .+204 ; 0x136 <_exit>
0000006a <__bad_interrupt>:
6a: ca cf rjmp .-108 ; 0x0 <__vectors>
0000006c <step>:
};
volatile uint8_t ind = 0;
void step() {
uint8_t i = ind;
6c: 80 91 10 01 lds r24, 0x0110
PORTB = led[i];
70: 90 e0 ldi r25, 0x00 ; 0
72: fc 01 movw r30, r24
74: e0 50 subi r30, 0x00 ; 0
76: ff 4f sbci r31, 0xFF ; 255
78: 20 81 ld r18, Z
7a: 25 b9 out 0x05, r18 ; 5
PORTD = motor[i];
7c: fc 01 movw r30, r24
7e: ed 5f subi r30, 0xFD ; 253
80: fe 4f sbci r31, 0xFE ; 254
82: 20 81 ld r18, Z
84: 2b b9 out 0x0b, r18 ; 11
ADMUX = mux[i];
86: 87 5f subi r24, 0xF7 ; 247
88: 9e 4f sbci r25, 0xFE ; 254
8a: fc 01 movw r30, r24
8c: 80 81 ld r24, Z
8e: 80 93 7c 00 sts 0x007C, r24
}
92: 08 95 ret
00000094 <runon>:
/*for(uint8_t k=0;k<120;k++) {
ind = k%6;
step();
_delay_ms(10);
}*/
}
94: 08 95 ret
00000096 <ANA_COMP_vect>:
ISR(ANA_COMP_vect) {
96: 1f 92 push r1
98: 0f 92 push r0
9a: 0f b6 in r0, 0x3f ; 63
9c: 0f 92 push r0
9e: 11 24 eor r1, r1
a0: 2f 93 push r18
a2: 3f 93 push r19
a4: 4f 93 push r20
a6: 5f 93 push r21
a8: 6f 93 push r22
aa: 7f 93 push r23
ac: 8f 93 push r24
ae: 9f 93 push r25
b0: af 93 push r26
b2: bf 93 push r27
b4: ef 93 push r30
b6: ff 93 push r31
ind = ind+1%6;
b8: 80 91 10 01 lds r24, 0x0110
bc: 8f 5f subi r24, 0xFF ; 255
be: 80 93 10 01 sts 0x0110, r24
step();
c2: d4 df rcall .-88 ; 0x6c <step>
//_delay_ms(10);
}
c4: ff 91 pop r31
c6: ef 91 pop r30
c8: bf 91 pop r27
ca: af 91 pop r26
cc: 9f 91 pop r25
ce: 8f 91 pop r24
d0: 7f 91 pop r23
d2: 6f 91 pop r22
d4: 5f 91 pop r21
d6: 4f 91 pop r20
d8: 3f 91 pop r19
da: 2f 91 pop r18
dc: 0f 90 pop r0
de: 0f be out 0x3f, r0 ; 63
e0: 0f 90 pop r0
e2: 1f 90 pop r1
e4: 18 95 reti
000000e6 <main>:
int main(void) {
DDRB |= (1<<PB3) | (1<<PB4) | (1<<PB5) | (1<<PB0);
e6: 84 b1 in r24, 0x04 ; 4
e8: 89 63 ori r24, 0x39 ; 57
ea: 84 b9 out 0x04, r24 ; 4
DDRD = 0b00111111;
ec: 8f e3 ldi r24, 0x3F ; 63
ee: 8a b9 out 0x0a, r24 ; 10
DDRD &=~ AINpin;//as input
f0: 8a b1 in r24, 0x0a ; 10
f2: 8f 73 andi r24, 0x3F ; 63
f4: 8a b9 out 0x0a, r24 ; 10
PORTD &=~ AINpin;//no Pull-up
f6: 8b b1 in r24, 0x0b ; 11
f8: 8f 73 andi r24, 0x3F ; 63
fa: 8b b9 out 0x0b, r24 ; 11
runon();
cli();
fc: f8 94 cli
ADCSRB |=(1<<ACME);//enable multiplexer
fe: 80 91 7b 00 lds r24, 0x007B
102: 80 64 ori r24, 0x40 ; 64
104: 80 93 7b 00 sts 0x007B, r24
ADCSRA &=~(1<<ADEN);//make sure ADC is OFF
108: 80 91 7a 00 lds r24, 0x007A
10c: 8f 77 andi r24, 0x7F ; 127
10e: 80 93 7a 00 sts 0x007A, r24
//ADMUX|=(0<<MUX2)|(1<<MUX1)|(1<<MUX0); //select ADC3 as negative AIN
ACSR |= (1<<ACIS1)|(0<<ACIS0);
112: 80 b7 in r24, 0x30 ; 48
114: 82 60 ori r24, 0x02 ; 2
116: 80 bf out 0x30, r24 ; 48
ACSR |= (1<<ACIE); // Comparator Interrupt Enable setzen damit Interrupt aktiv
118: 80 b7 in r24, 0x30 ; 48
11a: 88 60 ori r24, 0x08 ; 8
11c: 80 bf out 0x30, r24 ; 48
(0<<ACIC)| //input capture disabled
(0<<ACIS1)| //set interrupt on output toggle
(0<<ACIS0); */
PORTB = led[1];
11e: 80 91 01 01 lds r24, 0x0101
122: 85 b9 out 0x05, r24 ; 5
PORTD = motor[1];
124: 80 91 04 01 lds r24, 0x0104
128: 8b b9 out 0x0b, r24 ; 11
ADMUX = mux[1];
12a: 80 91 0a 01 lds r24, 0x010A
12e: 80 93 7c 00 sts 0x007C, r24
sei();
132: 78 94 sei
134: ff cf rjmp .-2 ; 0x134 <main+0x4e>
00000136 <_exit>:
136: f8 94 cli
00000138 <__stop_program>:
138: ff cf rjmp .-2 ; 0x138 <__stop_program>